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华为海思数字芯片设计【面试题】

9999spl 回答数11 浏览数1538
岗位:华为海思数字芯片设计实习生。
【第一面,专业面】

首先自我介绍。
面试官问简历上的科研和项目。
然后开始笔试,一共四道题。(面试现场做笔试题)
1.说明电路的建立时间和保持时间。
2.导致亚稳态的原因。
3.100MHz时钟和20MHz时钟之间,一台单时钟脉宽的信号如何采样:
从慢到快:直接通过两位寄存器串联,打两拍就可以。
从快到慢:把信号做翻转,转变为时钟沿的变化,然后用慢的时钟进行采样。
4.格雷码和二进制编码的概念,二者之间的转换电路:通过卡诺图进行设计。
此外,其他的题目包括:同步FIFO、异步FIFO。
主要考察了数字电路的时序问题。
比较简单。
【第二面,业务主管面】

时间比较短,印象中也就十几分钟。
这一面的面试官一般是对应部门的主管,级别都比较高(有独立办公室)。
先让自我介绍。
然后开始聊人生。
性格、经历、抗压能力、兴趣点。
聊完人生,就开始说实习的时间和到岗时间。
让我反问。
问了实习转正的事情。
【总结】

华为的面试比较简单,后续顺利通过。
不过需要注意的点,面试之前会有很多不同部门的HR来联系你,如果和某个部门的HR说好了,后续你的流程基本上锁死在他们部门了,秋招也很难换部门。
有的部门比较坑爹,建议提前找内部的师兄师姐打听清楚。
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| 来自北京 用Deepseek满血版问问看
a54ly | 来自北京
哥还没毕业
用Deepseek满血版问问看
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xiaocaocs00 | 来自云南
100M  20M从快到慢采样,没太理解
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WUnxjIDb | 来自北京
请问你是芯片封装岗位嘛
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wyf198500 | 未知
现在弄明白了吗
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yzjyb721016 | 来自吉林
还是没理解
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462710480 | 来自湖北
CDC跨时钟域 1bit 从快到慢-可以采用异步fifo,或者握手机制实现,似乎也可以使用乒乓buff实现
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icefox57 | 来自河南
现在呢哈哈,又看到这个问题了
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山鹰0731 | 来自北京
现在我理解了
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Rain真意 | 来自北京
意思是100M的快时钟采集20M慢时钟域的信息吗
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